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工作內(nèi)容：
1.參與系統(tǒng)整體方案設(shè)計(jì)，F(xiàn)PGA選型，數(shù)據(jù)流程分
析設(shè)計(jì)；
2.負(fù)責(zé)音頻領(lǐng)域新技術(shù)預(yù)研與應(yīng)用拓展，負(fù)責(zé) FPGA
邏輯開發(fā)調(diào)試，時序優(yōu)化;
3.負(fù)責(zé)編寫相關(guān)的設(shè)計(jì)文檔，同軟、硬件設(shè)計(jì)人員
一起完成聯(lián)調(diào);
4.熟悉研發(fā)整體設(shè)計(jì)流程；能獨(dú)立完成某項(xiàng)目的研發(fā)；
5.熟悉各種音頻接口，熟悉音頻信號的處理
6.對音頻或音樂有濃厚的興趣，***具備調(diào)音臺的知識；
7.熟悉數(shù)字調(diào)音臺，處理器等音頻產(chǎn)品。

工作職責(zé)要求：
1.FPGA邏輯開發(fā)：負(fù)責(zé)音頻處理相關(guān)的FPGA邏輯設(shè)計(jì)、編碼和調(diào)試工作，這可能包括子模塊的架構(gòu)設(shè)計(jì)、編碼、仿真和調(diào)試 。
2. 方案設(shè)計(jì)：負(fù)責(zé)項(xiàng)目中FPGA方案的設(shè)計(jì)，包括原理設(shè)計(jì)和數(shù)字邏輯分析 。
3. 代碼編寫與維護(hù)：進(jìn)行FPGA代碼的編寫、維護(hù)以及設(shè)計(jì)文檔的撰寫和維護(hù) 。
4. 仿真與驗(yàn)證：對局部模塊搭建仿真模型，執(zhí)行仿真并對系統(tǒng)進(jìn)行驗(yàn)證 。
5. 技術(shù)支持與調(diào)試：配合整體進(jìn)行系統(tǒng)調(diào)試，提供已有設(shè)備的技術(shù)支持，并解決開發(fā)過程中的問題 。
6. 技術(shù)文檔編寫：負(fù)責(zé)設(shè)計(jì)文檔、接口文檔及仿真測試文檔的編寫 。
7. 資源優(yōu)化與時序優(yōu)化：進(jìn)行FPGA調(diào)試，資源優(yōu)化與時序優(yōu)化，以確保音頻處理的高性能和穩(wěn)定性 。
8. 算法實(shí)現(xiàn)：將MATLAB算法程序轉(zhuǎn)換到FPGA VHDL語言，并負(fù)責(zé)部分新算法的研究分析。
9.有音視頻相關(guān)項(xiàng)目者優(yōu)先，具有數(shù)字調(diào)音臺、音頻處理器等專業(yè)音頻產(chǎn)品以及具有FIR,IIR,EQ,EFFECTS等音頻信號處理經(jīng)驗(yàn)者優(yōu)先
10.具有良好的理解能力和英文閱讀能力;
11.具有較好的團(tuán)隊(duì)合作意識，能夠積極主動的完成相關(guān)工作；

工作經(jīng)歷要求：
1.學(xué)歷要求：本科及以上學(xué)歷，電子類相關(guān)專業(yè)。
專業(yè)技能：熟練使用Verilog/VHDL編碼，具有獨(dú)立FPGA編碼、仿真、調(diào)試能力。
2.經(jīng)驗(yàn)要求：有音頻信號處理理論知識和相關(guān)經(jīng)驗(yàn)，熟悉FPGA器件結(jié)構(gòu)、資源，以及FPGA研發(fā)流程。
3.工具熟練度：熟悉使用Xilinx、Altera等FPGA開發(fā)工具，如Modelsim、Synplify、ISE或Quartus II等。
4.硬件基礎(chǔ)：具有一定硬件基礎(chǔ)，熟悉FPGA、DSP和ARM協(xié)同工作過程。