FPGA工程師
面議
應(yīng)屆畢業(yè)生
學(xué)歷不限
應(yīng)屆畢業(yè)生
學(xué)歷不限
- 全勤獎(jiǎng)
- 節(jié)日福利
- 不加班
- 周末雙休
2025-05-07 05:52:37
1800人關(guān)注
職位描述
該職位還未進(jìn)行加V認(rèn)證，請(qǐng)仔細(xì)了解后再進(jìn)行投遞！
崗位職責(zé)：1. 負(fù)責(zé)FPGA工業(yè)相機(jī)開發(fā)，包括需求分析、方案設(shè)計(jì)、編碼、仿真、調(diào)試以及開發(fā)流程的制定；2. 負(fù)責(zé)圖像處理模塊和視頻編解碼模塊的FPGA實(shí)現(xiàn)；3. 制定項(xiàng)目流程總結(jié)性文檔，與軟、硬件協(xié)調(diào)輸出相關(guān)規(guī)范文檔；4. 參與實(shí)際項(xiàng)目中的難題攻關(guān)。崗位要求：1. 本科及以上學(xué)歷，通信、電子和微電子類相關(guān)專業(yè)；2. 熟悉FPGA相關(guān)開發(fā)工作流程，有參與過(guò)圖像處理和視頻編解碼開發(fā)與實(shí)現(xiàn)相關(guān)項(xiàng)目者優(yōu)先；3. 精通Verilog/VHDL語(yǔ)言中的一種，***能對(duì)邏輯和時(shí)序優(yōu)化有較為深入的理解；4. 熟練使用FPGA相關(guān)開發(fā)工具，熟悉基本Linux/Unix操作；5. 有良好的團(tuán)隊(duì)合作精神，善于溝通，有責(zé)任心和上進(jìn)心。
職能類別：FPGA開發(fā)工程師
關(guān)鍵字：Verilog/VHDL
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工作地點(diǎn)
地址：深圳南山區(qū)深圳-南山區(qū)
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